lustrec-tests / vhdl_json / vhdl_files / 2-exportOK / forth-cpu / ram.json @ 2051e520
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| 1 | 2051e520 | Arnaud Dieumegard | {
|
|---|---|---|---|
| 2 | "DESIGN_FILE" : {
|
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| 4 | "contexts" : [["LIBRARY_CLAUSE", [["IDENTIFIER", "ieee"], ["IDENTIFIER", "work"]]], ["USE_CLAUSE", [["SELECTED_NAME", [["SIMPLE_NAME", "ieee"], ["SIMPLE_NAME", "std_logic_1164"]]]]], ["USE_CLAUSE", [["SELECTED_NAME", [["SIMPLE_NAME", "ieee"], ["SIMPLE_NAME", "numeric_std"]]]]]], "library" : ["ENTITY_DECLARATION", { |
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| 5 | "name" : ["IDENTIFIER", "ram_interface"], "ports" : [{ |
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|
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| 43 | "args" : [["CONSTANT_VALUE", { |
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||
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||
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| 109 | , {
|
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| 110 | "names" : [["IDENTIFIER", "mem_data_o"]], "mode" : ["out"], "typ" : { |
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| 115 | "args" : [["CONSTANT_VALUE", { |
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| 133 | "args" : [["EXPRESSION", { |
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| 135 | "args" : [["EXPRESSION", { |
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| 149 | "args" : [["EXPRESSION", { |
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| 150 | "args" : [["CONSTANT_VALUE", { |
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| 157 | , {
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| 163 | "args" : [["EXPRESSION", { |
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| 164 | "args" : [["CONSTANT_VALUE", { |
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| 272 | "ranges" : [["RANGE_WITH_DIRECTION", { |
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| 313 | , {
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| 315 | "name" : ["IDENTIFIER", "rtl"], "entity" : ["IDENTIFIER", "ram_interface"], "ARCHITECTURE_DECLARATIVE_PART" : [{ |
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| 317 | "names" : [["IDENTIFIER", "mem_data_buf_i"]], "typ" : { |
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| 327 | "args" : [["AGGREGATE", { |
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| 328 | "elems" : [{
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| 329 | "choices" : [["OTHERS"]], "expr" : ["EXPRESSION", { |
||
| 330 | "args" : [["EXPRESSION", { |
||
| 331 | "args" : [["EXPRESSION", { |
||
| 332 | "args" : [["EXPRESSION", { |
||
| 333 | "args" : [["CONSTANT_VALUE", { |
||
| 334 | "value" : ["CST_LITERAL", "'0'"]} |
||
| 335 | ]]} |
||
| 336 | ]]} |
||
| 337 | ]]} |
||
| 338 | ]]} |
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| 349 | "names" : [["IDENTIFIER", "mem_control_o"]], "typ" : { |
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| 351 | "ranges" : [["NAMED_RANGE", ["ATTRIBUTE_NAME", { |
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| 352 | "id" : ["SIMPLE_NAME", "mem_control_i"], "designator" : ["SIMPLE_NAME", "range"]} |
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| 353 | ]]]} |
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| 355 | , "init_val" : ["EXPRESSION", { |
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| 356 | "args" : [["EXPRESSION", { |
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| 357 | "args" : [["EXPRESSION", { |
||
| 358 | "args" : [["EXPRESSION", { |
||
| 359 | "args" : [["AGGREGATE", { |
||
| 360 | "elems" : [{
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| 361 | "choices" : [["OTHERS"]], "expr" : ["EXPRESSION", { |
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| 362 | "args" : [["EXPRESSION", { |
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| 363 | "args" : [["EXPRESSION", { |
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| 364 | "args" : [["EXPRESSION", { |
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| 383 | , "init_val" : ["EXPRESSION", { |
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| 384 | "args" : [["EXPRESSION", { |
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| 386 | "args" : [["EXPRESSION", { |
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| 387 | "args" : [["CONSTANT_VALUE", { |
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| 389 | ]]} |
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| 390 | ]]} |
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| 391 | ]]} |
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| 395 | , {
|
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| 397 | "names" : [["IDENTIFIER", "mem_oe"]], "typ" : { |
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| 404 | "value" : ["CST_LITERAL", "'0'"]} |
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| 429 | "args" : [["CONSTANT_VALUE", { |
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| 443 | , {
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| 444 | "declaration" : ["SIGNAL_DECLARATION", { |
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| 445 | "names" : [["IDENTIFIER", "mem_addr_high"]], "typ" : { |
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| 446 | "name" : ["SIMPLE_NAME", "std_ulogic_vector"], "const" : ["INDEX_CONSTRAINT", { |
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| 448 | "id" : ["SIMPLE_NAME", "mem_addr_26_17"], "designator" : ["SIMPLE_NAME", "range"]} |
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| 449 | ]]]} |
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| 451 | , "init_val" : ["EXPRESSION", { |
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| 454 | "args" : [["EXPRESSION", { |
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| 455 | "args" : [["AGGREGATE", { |
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| 456 | "elems" : [{
|
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| 457 | "choices" : [["OTHERS"]], "expr" : ["EXPRESSION", { |
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| 458 | "args" : [["EXPRESSION", { |
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||
| 483 | "id" : "&", "args" : [["EXPRESSION", { |
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||
| 486 | ]]} |
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|
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| 493 | "direction" : "downto", "from" : ["EXPRESSION", { |
||
| 494 | "args" : [["EXPRESSION", { |
||
| 495 | "args" : [["CALL", ["ATTRIBUTE_NAME", { |
||
| 496 | "id" : ["SIMPLE_NAME", "mem_addr_low"], "designator" : ["SIMPLE_NAME", "high"]} |
||
| 497 | ]]]} |
||
| 498 | ]]} |
||
| 499 | ], "_to" : ["EXPRESSION", { |
||
| 500 | "args" : [["EXPRESSION", { |
||
| 501 | "id" : "+", "args" : [["EXPRESSION", { |
||
| 502 | "args" : [["CALL", ["ATTRIBUTE_NAME", { |
||
| 503 | "id" : ["SIMPLE_NAME", "mem_addr_low"], "designator" : ["SIMPLE_NAME", "low"]} |
||
| 504 | ]]]} |
||
| 505 | ], ["EXPRESSION", {
|
||
| 506 | "args" : [["CONSTANT_VALUE", { |
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| 507 | "value" : ["CST_LITERAL", "1"]} |
||
| 508 | ]]} |
||
| 509 | ]]} |
||
| 510 | ]]} |
||
| 511 | ]} |
||
| 512 | ]} |
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| 513 | ]]]} |
||
| 514 | ]]} |
||
| 515 | ]]} |
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| 516 | ]]} |
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| 524 | "id" : ["SIMPLE_NAME", "mem_addr_16_1"], "designator" : ["SIMPLE_NAME", "length"]} |
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| 542 | "args" : [["EXPRESSION", { |
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| 543 | "args" : [["CONSTANT_VALUE", { |
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| 546 | ]]} |
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| 552 | , {
|
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||
| 554 | , {
|
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| 555 | "formal_name" : ["SIMPLE_NAME", "we"], "actual_designator" : ["SIMPLE_NAME", "mem_addr_26_17_we"]} |
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| 556 | , {
|
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| 557 | "formal_name" : ["SIMPLE_NAME", "di"], "actual_designator" : ["SIMPLE_NAME", "mem_addr_26_17"]} |
||
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| 559 | "formal_name" : ["SIMPLE_NAME", "do"], "actual_designator" : ["SIMPLE_NAME", "mem_addr_high"]} |
||
| 560 | ]} |
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| 561 | ], ["COMPONENT_INSTANTIATION_STATEMENT", {
|
||
| 562 | "name" : ["IDENTIFIER", "mem_control_reg"], "inst_unit" : ["SELECTED_NAME", [["SIMPLE_NAME", "work"], ["IDENTIFIER", "reg"]]], "generic_map" : [{ |
||
| 563 | "formal_name" : ["SIMPLE_NAME", "N"], "actual_expr" : ["EXPRESSION", { |
||
| 564 | "args" : [["EXPRESSION", { |
||
| 565 | "args" : [["EXPRESSION", { |
||
| 566 | "args" : [["EXPRESSION", { |
||
| 567 | "args" : [["CONSTANT_VALUE", { |
||
| 568 | "value" : ["CST_LITERAL", "6"]} |
||
| 569 | ]]} |
||
| 570 | ]]} |
||
| 571 | ]]} |
||
| 572 | ]]} |
||
| 573 | ]} |
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| 574 | ], "port_map" : [{
|
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||
| 576 | , {
|
||
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||
| 578 | , {
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| 579 | "formal_name" : ["SIMPLE_NAME", "we"], "actual_designator" : ["SIMPLE_NAME", "mem_control_we"]} |
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| 580 | , {
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||
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| 582 | , {
|
||
| 583 | "formal_name" : ["SIMPLE_NAME", "do"], "actual_designator" : ["SIMPLE_NAME", "mem_control_o"]} |
||
| 584 | ]} |
||
| 585 | ], ["COMPONENT_INSTANTIATION_STATEMENT", {
|
||
| 586 | "name" : ["IDENTIFIER", "mem_data_i_reg"], "inst_unit" : ["SELECTED_NAME", [["SIMPLE_NAME", "work"], ["IDENTIFIER", "reg"]]], "generic_map" : [{ |
||
| 587 | "formal_name" : ["SIMPLE_NAME", "N"], "actual_designator" : ["ATTRIBUTE_NAME", { |
||
| 588 | "id" : ["SIMPLE_NAME", "mem_data_i"], "designator" : ["SIMPLE_NAME", "length"]} |
||
| 589 | ]} |
||
| 590 | ], "port_map" : [{
|
||
| 591 | "formal_name" : ["SIMPLE_NAME", "clk"], "actual_designator" : ["SIMPLE_NAME", "clk"]} |
||
| 592 | , {
|
||
| 593 | "formal_name" : ["SIMPLE_NAME", "rst"], "actual_designator" : ["SIMPLE_NAME", "rst"]} |
||
| 594 | , {
|
||
| 595 | "formal_name" : ["SIMPLE_NAME", "we"], "actual_designator" : ["SIMPLE_NAME", "mem_data_i_we"]} |
||
| 596 | , {
|
||
| 597 | "formal_name" : ["SIMPLE_NAME", "di"], "actual_designator" : ["SIMPLE_NAME", "mem_data_i"]} |
||
| 598 | , {
|
||
| 599 | "formal_name" : ["SIMPLE_NAME", "do"], "actual_designator" : ["SIMPLE_NAME", "mem_data_buf_i"]} |
||
| 600 | ]} |
||
| 601 | ], ["CONDITIONAL_SIGNAL_ASSIGNMENT", {
|
||
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||
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||
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||
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||
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||
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||
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||
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||
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||
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||
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||
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||
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||
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| 636 | ]]]} |
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|
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||
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||
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||
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||
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|
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||
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||
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||
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||
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||
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||
| 661 | ]]} |
||
| 662 | ]]} |
||
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||
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||
| 665 | ]} |
||
| 666 | ]]]} |
||
| 667 | ]]} |
||
| 668 | ]]} |
||
| 669 | ], ["EXPRESSION", {
|
||
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||
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||
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||
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||
| 676 | ]]} |
||
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||
| 678 | ]]} |
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| 679 | ]} |
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| 680 | , {
|
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||
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||
| 683 | "args" : [["EXPRESSION", { |
||
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||
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||
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||
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||
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||
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||
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| 695 | ], ["CONDITIONAL_SIGNAL_ASSIGNMENT", {
|
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| 696 | "postponed" : false, "lhs" : ["SIMPLE_NAME", "RamCS"], "rhs" : [{ |
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| 697 | "expr" : [{
|
||
| 698 | "value" : ["EXPRESSION", { |
||
| 699 | "args" : [["EXPRESSION", { |
||
| 700 | "args" : [["EXPRESSION", { |
||
| 701 | "args" : [["EXPRESSION", { |
||
| 702 | "args" : [["CONSTANT_VALUE", { |
||
| 703 | "value" : ["CST_LITERAL", "'0'"]} |
||
| 704 | ]]} |
||
| 705 | ]]} |
||
| 706 | ]]} |
||
| 707 | ]]} |
||
| 708 | ]} |
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| 709 | ], "cond" : ["EXPRESSION", { |
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| 710 | "id" : "and", "args" : [["EXPRESSION", { |
||
| 711 | "id" : "/=", "args" : [["EXPRESSION", { |
||
| 712 | "args" : [["EXPRESSION", { |
||
| 713 | "args" : [["EXPRESSION", { |
||
| 714 | "args" : [["CALL", ["SLICE_NAME", { |
||
| 715 | "id" : ["SIMPLE_NAME", "mem_control_o"], "range" : ["RANGE_WITH_DIRECTION", { |
||
| 716 | "direction" : "downto", "from" : ["EXPRESSION", { |
||
| 717 | "args" : [["EXPRESSION", { |
||
| 718 | "args" : [["CONSTANT_VALUE", { |
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| 719 | "value" : ["CST_LITERAL", "5"]} |
||
| 720 | ]]} |
||
| 721 | ]]} |
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| 722 | ], "_to" : ["EXPRESSION", { |
||
| 723 | "args" : [["EXPRESSION", { |
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| 724 | "args" : [["CONSTANT_VALUE", { |
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| 727 | ]]} |
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| 728 | ]} |
||
| 729 | ]} |
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| 730 | ]]]} |
||
| 731 | ]]} |
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| 732 | ]]} |
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| 733 | ], ["EXPRESSION", {
|
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| 739 | ]]} |
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| 740 | ]]} |
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| 741 | ]]} |
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| 742 | ], ["EXPRESSION", {
|
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| 747 | "id" : ["SIMPLE_NAME", "mem_control_o"], "assoc_list" : [{ |
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||
| 754 | ]]} |
||
| 755 | ]]} |
||
| 756 | ]]} |
||
| 757 | ]]} |
||
| 758 | ]} |
||
| 759 | ]} |
||
| 760 | ]]]} |
||
| 761 | ]]} |
||
| 762 | ]]} |
||
| 763 | ], ["EXPRESSION", {
|
||
| 764 | "args" : [["EXPRESSION", { |
||
| 765 | "args" : [["EXPRESSION", { |
||
| 766 | "args" : [["CONSTANT_VALUE", { |
||
| 767 | "value" : ["CST_LITERAL", "'1'"]} |
||
| 768 | ]]} |
||
| 769 | ]]} |
||
| 770 | ]]} |
||
| 771 | ]]} |
||
| 772 | ]]} |
||
| 773 | ]} |
||
| 774 | , {
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| 1154 | "postponed" : false, "lhs" : ["SIMPLE_NAME", "MemDB"], "rhs" : [{ |
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| 1155 | "expr" : [{
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| 1161 | "id" : ["SIMPLE_NAME", "std_logic_vector"], "assoc_list" : [{ |
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| 1162 | "actual_designator" : ["SIMPLE_NAME", "mem_data_buf_i"]} |
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| 1163 | ]} |
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| 1164 | ]]]} |
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| 1170 | "id" : "=", "args" : [["EXPRESSION", { |
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| 1173 | "args" : [["CALL", ["SIMPLE_NAME", "mem_we"]]]} |
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| 1174 | ]]} |
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| 1175 | ]]} |
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| 1176 | ], ["EXPRESSION", {
|
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| 1177 | "args" : [["EXPRESSION", { |
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| 1180 | "value" : ["CST_LITERAL", "'1'"]} |
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| 1187 | "expr" : [{
|
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